＜Data Center＞Serdes數位IC設計工程師

1.Propose design verification plan and do the execution based on IP and system HW architecture/application 

2.Develop design verification environment 

3.Develop required verification methodology and adopt into project

1. CPU system design and performance analysis  

2. AMBA System bus architecture and integration  

3. IP and system design and verification

1. 先進SoC晶片設計整合  

2. 先進製程 IC 設計實現與技術開發  

3. 關鍵 IP RTL-2-GDS 技術開發

1. AI 處理器系統架構/微架構設計  

2. AI 處理器系統 BUS 與 memory, power/clock/reset 控制電路及其周邊相關電路設計  

3. 車用安全性相關設計

1. 優化數位 IC 設計 BE 流程與方法 

2. 執行與管理數位 IC 設計 BE 相關任務 

(2.a) Physical aware synthesis, DFT-SCAN, DFT-MBIST insertion 

(2.b) STA timing analysis 與 fixing 

(2.c) Netlist level QC，例如 CLP 

3. 與 FE RTL designer 及 PD APR 團隊密切合作，針對 PPA（Performance, Power, Area）進行 design 及 clock structure 的優化 

4. 將依應徵者的年資與專業經驗，提供不同的職級

1. 使用模擬工具分析汽車SoC的性能、功耗和熱管理指標。 

2. 改進模擬模型，識別並針對SoC最佳化領域。 

3. 實施策略，提升車載SoC的性能和效率。 

4. 自動化評估流程，實現持續的SoC最佳化。 

5. 跟進汽車SoC設計的最新進展，專注於系統層面的改進。

專注於新產品導入 (NPI)、良率提升和測試時間縮短。 擅長跨職能團隊協作和流程改進，涵蓋從晶圓分選到最終測試的各個環節。

1. Familiar with HSIO spec (PCIE, USB, UFS, DP, ...etc) and system usage scenario 

2. Familiar with Windows and Android OS 

3. Experienced with PC south bridge design 

4. Experienced with PC USB host chipset design

1. CPU system design and performance analysis 

2. System bus architecture and integration 

3. IP and system verification 

4. Debug Architecture related IP design and integration

(請留意：為加快面試安排時間，僅限定投遞5個職缺)我們在找這樣的你：對行動通訊、無線及寛頻連結、家庭娛樂晶片解決方案有濃厚興趣；勇於表達意見，以團隊成功為目標，面對困難不輕易放棄，總是在想更好的做法，擁有創新及不斷學習的精神。聯發科技邀請您，與全球最頂尖的菁英一同合作，彼此激盪最新的創意與解法，共同挑戰每一個不可能。

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1. Responsible for high-speed UCIE development, including architecture definition, verification, and customer support (familiar with architecture, firmware, debugging, optimization, and testing tasks). 

2. Define architecture and specifications through simulations. ( Matlab ) 

3. Develop test automation. 

4. Collaborate with the team to establish system prototypes and optimize performance. 

5. Achieve product integration for clients and support mass production.

無線通訊系統數位ip 設計實現

Multi-RAT (6G/5G/4G/3G/2G) modem development. This is a common job description. You may involve at least one or more topics in the following: 

(1) architecture planning 

1.1 Modem/SoC TOP system architecture 

1.2 Modem/SoC CPU system design 

1.3 Modem/SoC DSP system design 

1.4 Modem/SoC BUS system design 

(2) digital circuit design and verification 

2.1 baseband modules 

2.2 digital front-end modules 

2.3 RF/mixed-mode digital control modules 

2.4 Computer/network system modules 

2.5 High speed interface design 

(3) IP integration 

3.1 Clock/reset, test modeand low power mode design 

3.2 floorplan and synthesis development 

(4) Design methodology 

4.1 design flow enhancement (low power/verification/etc) 

4.2 chip MP quality control flow

1. 5G modem 架與數位電路設計 

2. CLK, 測試, Reset相關設計與規劃 

3. 低功耗設計 

4. 系統整合 RTL 到 Gate level, 含STA