Senior Physical Design / APR Engineer / APR Manager(新竹)

工作項目： 

1. 研發/導入Emulation/Prototyping技術。 

2. Emulation Performance Optimization. 

3. Validation Flow Optimization. 

4. 自動化程式開發。 

應徵條件： 

1. 碩士; 電機工程、資訊工程相關科系畢業為主; 兩科系/領域都有學歷者佳。 

2. 熟悉 Synopsys Zebu/HAPS or Cadence Palladium/Protium者佳。 

3. 熟悉 IC Validation Flow or Software Bring Up Flow者佳。 

4. 熟悉自動化 script語言(Ex: Python)者佳。

工作項目： 

1. 建立IC設計後段驗證流程，並撰寫自動化程式。 

2. 建立並維護DRC/LVS/SVS/LVL/ERC/PERC相關檔案及流程。 

3. 分析並解決PV相關問題。 

應徵條件： 

1. 碩士以上；電機、電機與控制、電信、電子、資工、資訊相關科系畢業為佳。 

2. 無經驗可；具相關工作經驗者佳。 

3. 熟悉 Linux工作環境以及 TCL/shell script. 

4. 熟悉 Calibre(含TVF及SVRF)或 ICV. 

5. 熟悉 FinFET或 BCD製程為佳。

工作項目： 

1. 開發高效率 NAND flash控制器。 

2. 開發低功耗 NAND flash控制器。 

3. 協助IC設計前後段流程。 

4. 協助IC驗證流程。 

應徵條件： 

1. 學士以上; 電機工程、電信工程、電控工程、電子工程、資訊工程、資訊科學、自動控制、通訊工程相關科系畢業為主。 

2. 具1年以上相關工作經驗，熟悉 NAND flash控制器開發、IC設計/驗證流程者為佳。

工作項目： 

RFC DSP or High speed PHY相關設計。 

應徵條件： 

1. 碩士以上; 電機工程、電信工程、電控工程、電子工程、動力機械、自動控制、通訊工程等相關科系畢業為主。 

2. 無經驗可；具3年以上下列相關經驗之一者尤佳： 

(1) RF相關 calibration(DSP)設計經驗。 

(2) High speed PHY(USB2/3, PCIe, SATA, HDMI)相關設計經驗。 

(3) 熟悉數位 IC設計相關技術及流程者。

工作項目： 

1. 先進製程 IO pad 電路設計, ESD 問題排除. IO pad SI/ PI 分析。 

2. 特殊用途/ 規格 IO 的規格分析，電路設計與開發。 

應徵條件： 

1. 碩士以上；電機電子相關系所畢業，曾修習電子電路設計。 

2. 工作經驗：具備GPIO或DDR IO 電路設計經驗為主, 若有半導體物理, ESD/Latch-up 問題處理經驗尤佳。 

3. 年資不限, 有經驗優先考慮。

工作項目： 

Flash controller電路開發  

應徵條件： 

1. 碩士以上;電機工程、電信工程、資訊工程相關科系畢業為主 

2. 具2年以上數位IC設計相關經驗者為佳 

(MD1880018)

工作項目： 

Digital design verification, including direct test simulation, random test simulation and coverage report. 

應徵條件： 

1. 學士以上; 電機工程、電控工程、電子工程、資訊工程、資訊科學相關科系畢業為主。 

2. 具3年以上數位設計、驗證或 CAD 相關經驗者為佳。

工作項目： 

SoC Physical Design  

應徵條件： 

1. 碩士以上;電機工程、電子工程、資訊工程相關科系畢業為主。 

2. 具0年以上或2至3年相關經驗者為佳。 

(MD1840015)

Key qualifications: 

1. MS degree or above with EE or CS background 

2. Familiar with SystemVerilog and Verilog 

3. Exposure to OVM/UVM/VMM methodology 

4. Exposure to constrained-random based verification environment 

5. Exposure to create coverage model and drive coverage closure in including code/functional coverage. 

6. Be able to develop a test bench from scratch 

7. Hands on working experience on unit/block/full-chip level verification 

8. Good communication skill 

9. Leadership/management experience is a plus. 

Job descriptions: 

1. Plan the verification strategy for SOC projects 

2. Hands-on verification task of some of the units 

3. Work closely with the design teams. 

4. Drive the verification team, problem-solving on day-to-day works 

5. Provide the measurable metrics for project leads and upper management. 

6. Bug/coverage trend identification. Foresee the possible issues and plan for them. 

(MD17C0031)

Key qualifications: 

1. Master degree or above with EE or CS background 

2. Familiar with SystemVerilog and Verilog 

3. Exposure to OVM/UVM/VMM methodology 

4. Exposure to constrained-random based verification environment 

5. Exposure to create coverage model and drive coverage closure in including code/functional coverage. 

6. Be able to develop a test bench from scratch 

Preferred qualifications:  

1. Familiar with PCI/USB/SATA/Serdes 

2. Familiar with Bluetooth 

3. Familiar with SOC bus fabric and AXI/AHB/OCP bus protocols 

4. Familiar DDR2/3/4 

5. Familiar with any type of flash memory 

6. Familiar SVA 

7. Familiar Formal verification methodology 

8. Experience of writing bootloader for ARM/MIPS CPUs 

9. Perl/Python experience 

Job descriptions: 

1. Test plan creation 

2. Develop testbench, test cases, reference model, coverage model and regression suite 

3. Run RTL and gate level simulation, debug failures, manage bug tracking 

4. Drive and achieve coverage closure 

(MD17C0031)

工作項目： 

1. HS design verification. 

2. 開發 USB3.2及 PCIe4.0 

3. DV協助 HS & RFC. 

應徵條件： 

1. 碩士以上; 電機工程、電信工程、電控工程、電子工程、資訊工程、自動控制、通訊工程相關科系畢業為主。 

2. 具 HS/SERDES/DSP相關電路設計經驗者尤佳。 

3. 具 design verification經驗者尤佳。

工作項目： 

IC physical designer (APR)  

應徵條件： 

碩士以上; 電機工程、電子工程、資訊工程相關科系畢業為主

工作項目： 

1.AP/Router SoC & Platform development, Network & Peripheral IP design 

應徵條件： 

1. 碩士以上；電機、電機與控制、電信、電子相關科系畢業為主 

2. 具3年以上數位IC 相關經驗者為佳。 

(MD1720006)

工作項目： 

Design verification, UVM 

應徵條件： 

1. 大學以上；電機、電機與控制、資訊科學、自動控制、電信、資訊工程、電子、動力機械相關科系畢業為主。 

2. 具3~5年design verification 相關經驗者為佳。 

(MD1680021)

工作項目： 

1. Responsible for ASIC Backend / Physical Implementation, including floorplan, power plan, physical synthesis, clock tree synthesis, routing, si, DFM, DRC/LVS in both hierarchical and low power designs.  

2. Responsible for Physical Design flow research, development and automation. 

應徵條件： 

1. 大學以上電機資訊相關科系畢 

2. 熟悉 IC 後段設計流程, 具相關 APR 經驗者佳. 

3. 對於開發及推廣 Physical Design Flow 有興趣者. 

4. 熟悉相關 tools(Astro, Encounter, IC Compiler)者尤佳 

5. 具程式設計(TCL,Perl,C/C++)能力者佳。

工作項目： 

Verification for a CPU design project, which includes: 

* Responsibility for test plans, testbench documentation and implementation. 

* Use SystemVerilog language, SVA and UVM methodology for block and top level verification. 

* Apply formal property checking/formal verification methodologies 

* Understanding of the fundamentals of computer architecture  

應徵條件： 

1. 碩士以上；電機、電機與控制、資訊工程、電子相關科系畢業為主。 

2. 具相關工作經驗者尤佳。 

(MD1570002)

工作項目： 

1. RMA, HTOL問題協助排除。 

2. ESD/EOS可靠度問題協助排除。 

3. power/PCB ESD相關 SI/PI分析 (Cable ESD)處理。 

應徵條件： 

1. 碩士以上；電機電子相關系所畢業為主；曾修習電子電路設計、半導體物理、元件物理課程。 

2. 具2年以上半導體可靠度相關經驗者為佳。 

3. 具處理 IC ESD or System ESD問題處理經驗者尤佳。

工作項目： 

負責下列工作項目之一 

1. High performance core physical implementation 

2. Project Implementation and flow development. 

應徵條件： 

1. 碩士以上；電機、資訊科學、資訊工程相關科系畢業為主。

工作項目： 

Switch/PON 數位IC設計 

應徵條件： 

1. 碩士以上，電機工程、電信工程、電子工程、通訊工程相關科系畢業為主 

2. 具基本的DATA Communication通訊知識為佳  

3. 具RTL電路設計、驗證、合成經驗  

4. 熟悉邏輯、電子與電路設計等相關經驗者為佳

工作項目： 

負責下列工作之一 

1. SoC 平台開發及產品線支援。 

2. 微處理器開發。 

3. 低功耗軟體平台開發。 

應徵條件： 

1. 碩士以上；電機、資訊科學、資訊工程、電子相關科系畢業為主。 

2. 熟悉 Verilog RTL及Synthesis, Simulation, Verification 等相關 IC Design Flow. 

3. 熟悉 Computer Architecture 

4. 具下列經驗者尤佳: 

(1) On-chip Bus, DDR/Flash Memory Controller, PCIE, USB等設計 

(2) Embedded system軟體開發 

(3) ARM CPU 與 ARM/Imagination GPU 整合 

(MD1430014)